Tag Archives: Award

(日本語) DAシンポジウム2015優秀発表学生賞 受賞

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(日本語) 情報処理学会 コンピュータサイエンス領域奨励賞 受賞

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(日本語) 情報処理学会 山下記念研究賞 受賞

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(日本語) SLDM研究会 優秀論文賞・最優秀発表学生賞 受賞

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(日本語) 第27回 回路とシステムワークショップ 奨励賞 受賞

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(日本語) デザインガイア2014

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(日本語) SLDM研究会 優秀発表学生賞 受賞

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(日本語) 第26回 回路とシステムワークショップ 奨励賞 受賞

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SASIMI 2013

2013年10月21日~22日,SASIMI 2013 在札幌举办,本研究室的今川做了海报发表(发表日为10月21日). 今川的发表是关于,在利用时间多重化的粗粒度可再构成体系结构(CGRA)中的应用程序回路的布局和布线. 在回路面积被限制的情况下,时间多重化是比空間多重化效率更高的电路平均寿命改善方法. 在本研究中,特别考虑了通过把它应用到 CGRA 可同时提高软错误和硬错误的容错. 但是,通过这个方法达成的硬错误容错和电路性能间有权衡关系,本发表证明了通过应用程序回路的布局和布线可以控制此权衡关系. 通过此研究,可以预期医疗、车载、基础设施等领域的LSI系统的高效率的信赖性改善.  “SASIMI 2013 Outstanding Paper Award” Imagawa, Masayuki Hiromoto, Hiroshi Tsutsui, Hiroyuki Ochi, and Takashi Sato: “Place-and-Route Algorithms for a Reliability-Oriented Coarse-Grained Reconfigurable Architecture using Time Redundancy,” The 18th Workshop on Synthesis And System Integration … Continue reading

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VLD Excellent Student Author Award for ASP-DAC 颁奖仪式

2013年3月4日(周一),在冲绳县青年会馆举办的VLD 研究会上进行了VLD Excellent Student Author Award for ASP-DAC 优秀论文颁奖仪式。本研博士课程学长新谷先生光荣获奖。本次颁奖是对国际会议ASP-DAC采用的文章(采用率31.2%)中,特別优秀论文的执笔学生进行的奖赏。 授奖论文为: Michihiro Shintani and Takashi Sato, “An Adaptive Current-Threshold Determination for IDDQ Testing Based on Bayesian Process Parameter Estimation,” ACM/IEEE Asia South Pacific Design Automation Conference (ASP-DAC) (Pacifico Yokohama, Yokohama, Japan), … Continue reading

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